2021-02-01来源: EEWORLD作zhe: ADI公司 Wasim Shaikh 和 Srikanth Nittala 关键字:shu据caiji信hao链  ADI

jian介

 

moshu转换器(ADC)中的caiyanghui产生混叠和电容反冲问题,为此设计人员使用滤bo器和驱动放da器来解决,但这又带来了一系lie相关tao誮ianS绕涫窃谥械却?碛τ弥校?迪志?苤绷骱徒涣鱴ing能mian临tao战,设计人员最终不de不降低系统目标。

 

本wen介绍连续时间Σ-Δ ADC,通guojian化信hao链来觴ingЫ饩鯿aiyang问题。cai用这zhong方法无需使用抗混叠滤bo器和缓冲器,bing可解决与额外组件相关的信hao羉iУ鱳u差和漂移问题。进而可缩xiao解决方案尺寸,jian化设计,bing改善系统的相位匹配和整体延迟。

 

本wen还将连续时间转换器与离散时间转换器进xing了比较,bing着重介绍使用连续时间Σ-Δ ADC的系统优势和存在的限制。

 

caiyang基本yuan理

 

shu据shu字化包含caiyang和量化两个基本guo程,如图1所shi。caiyang是第一步,其中使用caiyang频率fS将连续时间可变mo拟信haox(t)转换为离散时间信haox(n)。最终de到yi 1/TS (fS = 1/TS)间隔的信hao。

 

Figure 1. Data sampling.

 

图1.shu据caiyang

 

 第二步是量化,将这些离散时间yang本值估suan为一个有限可能值,bing用shu字dai码表shi,如图1所shi。这zhong量化为一组有限值的操作hui导致shu字化wu差,称为量化噪sheng。

 

caiyangguo程也hui导致混叠,可yi看礿ie惺淙胄舎aozhe返yi及caiyang保硓hi敝悠德手躻ei出现xiebo。nai奎斯tezhun则要qiucaiyang频率bi须至少是最gao信hao频率的羓iang丁H绻鹀aiyang频率xiao于最damo拟信hao频率的羓iang叮?玥ui出现一zhong称为"混叠"的现象。

 

为了理解混叠在时域和频域中的含义,首先来看图2所shi的单信haoyin正xianbocaiyang信hao的时域表shi。在本例中,caiyang频率 fS不是 fa的至少2倍,只是稍微gao于mo拟输入频率 fa,因此不符合nai奎斯tezhun则。注意,实jiyang眏iu及竓ui产生较低频率 fS – fa的混叠正xianbo。

 

 

这zhong情况的相应频域表shi如图3所shi。

 

nai奎斯te带宽定义为从DC到 fS/2的频谱。该频谱可xifen为无shu个nai奎斯te区,每个区的宽秗en?nbsp;0.5fS。在实ji应用中,可yi将理想caiyang器用ADC后jieFFT处理器来dai替。FFT处理器仅提供DC到 fS/2fanwei内的输出;即第一nai奎斯te区出现的信hao或混叠。

 

如果cai用理想的脉冲caiyang器,在 fS 频率xia对 fa 频率的单频正xianbo进xingcaiyang(见图1)。ling外假定 fS > 2fa。caiyang器的频域输出显shi,每个 fS倍shu频率附近均hui出现yuan始信hao的混叠或镜xiang;即 |± KfS ± fa| 频率处,K = 1,2,3,4等。

 

jiexia来,我们kao虑第一nai奎斯te区之外的信hao(图3)。信hao频聅hi鰈uexiao于caiyang频率,jiu是图2中时域表shi的情形。注意,糲i剐舎ao位于第一nai奎斯te区之外,其镜xiang(或混叠) fS – fa仍位于该区内。回到图3。很明显,如果ren何镜xiang频率 fa处出现干扰信hao,那么也将hui出现在 fa,因而hui在第一nai奎斯te区内产生za散频率成fen。

 

解决tao战,实现精密xing能

 

秡a趃aoxing能应用,系统设计人员需要解决caiyangguo程导致的量化噪sheng、混叠和开关电容输入caiyang问题。两zhong类型的精密ADCducai用基于开关电容的caiyang糺i鮣ou建,这两zhongADCfen别是xing襠ixie<?闹餭ibi近ji存器(SAR)和Σ-Δ ADC。

 

量化噪sheng

 

在理想的nai奎斯teADC中,ADC的LSBdaxiao将决定进xingmoshu转换时带到输入中的量化噪sheng。这些量化噪shengdufen布在 fS/2带宽fanwei内。为了解决量化噪sheng问题,首先需要cai用guocaiyang糺i酰?磞ida幅gao于nai奎斯te频率的速率对输入信hao进xingcaiyang,yi提gao信噪比(SNR)和fen辨率(ENOB)。guocaiyang期间,xuan择使用的caiyang频率为nai奎斯te频率的N倍 (2 × fIN),因此bi须让相tong的量化噪shengfen布在N倍nai奎斯te频率fanwei内。这也hui放宽对抗混叠滤bo器的要qiu。guocaiyang率(OSR)定义为 fS/2fIN,其中 fIN 是目标信hao带宽。襤ua憷此担?訟DC进xing4倍guocaiyang可额外提供1位fen辨率,或增加6 dB的动态fanwei。提升guocaiyang率可降低整体噪shengbing增加动态fanwei(DR),因为guocaiyang为ΔDR = 10log10 OSR,单位dB。

 

guocaiyang可yi与ji成shu字滤bo器和抽取gong能一起使用和实现。Δ-Σ型ADC基本guocaiyang调制器对量化噪sheng进xing整形,使其da部fen出现在目标带宽yi外,从而增加低频xia的整体动态fanwei,如图4所shi。然后,shu字低通滤bo器(LPF)滤除目标带宽yi外的量化噪sheng,抽取器降低输出shu据速率,使其回落至nai奎斯te速率。

 

 

噪sheng整形是ling一zhong用于降低量化噪sheng的糺i酢T讦?Δ ADC中,在环lu滤bo器之后的环lu内使用低fen辨率(一位至五位)量化器。DAC用作反kui,用于提取输入中的量化信hao,如图5所shi。

 

 

积fen器将累加量化wu差,将量化噪sheng整形至更gao频率,然后使用shu字滤bo器进xing滤bo。图6所shi为典型的Σ-Δ ADC输出x[n]的gong率谱密度(PSD)。噪sheng整形斜率取决于环lu滤bo器的阶shuH(z)(见图11),每十倍频程为(20 × n) dB,其中n表shi环lu滤bo器的阶shu。Σ-Δ ADC通guo结合使用噪sheng整形和guocaiyang,可实现带内gaofen辨率。带内带宽等于 fODR/2 (ODR表shi输出shu据速率)。通guo提gao环lu滤bo器的阶shu或提gaoguocaiyang率,可yi获de更gao的fen辨率。

 

 

 

混叠

 

为了解决gaoxing能应用中的混叠,可使用更gao阶的抗混叠滤bo器来避mianren何shu量的混叠。抗混叠滤bo器是一kuan低通滤bo器,其带宽hui限制输入信hao,bing确保信hao中不含可yizhe返的目标带宽yi外的频率fen量。滤bo器xing能将取决于带外信hao与fS/2的jie近程度和所需的衰减量。

 

秡a赟AR ADC,输入信hao带宽和caiyang频率之间的差jubing不da,所yi我们需要使用更gao阶的滤bo器,这要qiucai用更复za、更gao阶的滤bo器设计,且gong率更gao,失真更da。例如,如果caiyang速秗en?00 kSPS的SAR的输入带宽为100 kHz,则抗混叠滤bo器需要襷hong毗100 kHz的输入信hao,yi确保不hui产生混叠。这jiu需要使用极gao阶的滤bo器。图7显shi了陡峭的需qiu曲xian。

 

 

 

如果xuan择使用400 kSPScaiyang速度来降祎u薭o器的阶shu,则需要襷hong毗300 kHz的输入频率。提gaocaiyang速度hui增加gong率,如果实现shuang倍速度,需要的gong率也hui翻倍。由于caiyang频率yuangao于输入带宽,因此yigong率为dai价进一步提gaoguocaiyanghui进一步放宽抗混叠滤bo器的要qiu。

 

在Σ-Δ ADC中,yi更gao的OSR对输入guocaiyang,由于caiyang频率yuangao于输入带宽,因而放宽了抗混叠滤bo器的要qiu,如图8所shi。

 

 

图9显shi了SAR和离散时间Σ-Δ(DTSD)jiagou中AAF的复za程度。如果我们要使用100 kHz –3 dB输入带宽在caiyang频率fSxia实现102 dB衰减,则DTSD ADC将需要使用二阶抗混叠滤bo器?uan鴆ai用SAR ADC时在 fS xia获de相tong衰减,则需要使用五阶滤bo器。

 

秡a诹??奔洇?Δ(CTSD) ADC,它本身ju有衰减gong能,所yi我们无需使用ren何抗混叠滤bo器。

 

这些滤bo器对系统设计人员来说du是难题,他们bi须优化这些滤bo器,yi便在目标频带内提供衰减,bing且尽可能提供更gao的襷hong苮ing能。它们还hui增加xu多其他wu差,例如失调、增益、相位wu差和系统噪sheng,进而降低其xing能。

 

而且,gaoxing能ADC本身是差fenshi,所yi我们需要使用shuang倍shu量祅ai拊醋榧?R?诙嗤╠ao应用中实现更好的相位匹配,信hao链中的所有组件也bi须匹配。因此,需要使用公差更褁i竦淖榧?Ⅻ/p>

 

开关电容输入

 

开关电容输入caiyang取决于电容上caiyang输入的建立时间,因此在开关caiyang开关时,需要chong电/放电瞬态电流。这称为输入反冲,要qiu使用zhi持这些瞬变电流的输入驱动放da器。此外,要qiu在caiyang时间结shu时建立输入,而且caiyang输入的精度决定ADC的xing能,意味着驱动放da器需要在反冲事件后快速稳定建立。因此需要使用zhi持快速建立bing能吸收开关电容操作反冲的gao带宽驱动器。在开关电容输入中,每dangcaiyang开启,驱动器bi须立糲i?3值缛萏峁┑缭础V挥衐ang驱动器ju备足够的带宽能力时,才能及时提供这zhong电流激增。由于开关ji生,caiyang时驱动器上hui出现反冲。如果反冲在xia一cicaiyang前未能稳定xia来,hui导致caiyangwu差,从而影响ADC输入。

 

 

图10显shi了DTSD ADC上的反冲。例如,如果caiyang频率为24 Mhz,那么shu据信hao需要在41 ns内建立。因为基zhun也是一个开关电容输入,所yi基zhun输入yin脚蓌ian残枰?桓鰃ao带宽缓冲器。这些输入信hao和基zhun电压缓冲器也hui增加噪sheng,使信hao链的整体xing能xia降。此外,输入信hao驱动器的失真fen量(在S&H频率附近)hui进一步提gao抗混叠要qiu。秡a诳?氐缛菔淙耄琧aiyang速度的变化hui导致输入电流变化。这可能导致重新调xie系统,yi减少驱动ADC时驱动器或前一级产生的增益wu差。

 

连续时间Σ-Δ ADC

 

CTSD ADC是ling一zhongΣ-Δ ADCjiagou,利用guocaiyang和噪sheng整形等yuan理,但提供ling一zhong实施caiyang的方法,ju有显著的系统优势。

 

图11将DTSDjiagou和CTSDjiagou进xing了比较。可yi看到,DTSDjiagou在环lu之前对输入caiyang。环lu滤bo器H(z)在时间上是离散祄o琤ing使用开关电容积fen器实现。反kuiDAC也是基于开关电容。由于进xing输入caiyanghui导致fS中产生混叠问题,所yi对输入caiyang之前需要在输入端使用抗混叠滤bo器。

 

 

 

CTSD未在输入端配置caiyang器,而是在环lu内的量化器上caiyang。环lu滤bo器使用连续时间积fen器实现了时间连续xing,反kuiDAC也是如此。与量化噪sheng受到整形一yang,因caiyang导致的混叠也hui被整形。由此de出了几乎无caiyang混叠的ADC,使其自成其类。

 

CTSD的caiyang频率是固定祄o?庥隓TSD不tong,后zhe的调制器caiyang频率可yi轻松扩zhan。此外,CTSD ADC秠uan抖?娜萑坛潭纫驳陀诳?氐缛軦DC。现成的晶体或CMOSzhen荡器为ADC提供本地低抖动时钟,有助于避mian在隔离状态xia传输低抖动时钟,bing降低EMC。

 

CTSDju有两da优势,它本身ju有混叠襷hong颇芰Γ琤ing且为信hao和基zhun提供阻xing输入。

 

固有的抗混叠能力

 

把量化器移到环lu内hui产生固有的混叠襷hong啤H缤?2所shi,输入信hao在caiyang前通guo环lu滤bo器,在量化器上产生的zhe返(混叠)wu差也hui经此滤bo苖eiコ?P舎ao和混叠wu差与Σ-Δ环luju有相tong的噪sheng传di函shu,bing莥i讦?Δjiagou中实施与量化噪sheng相似的噪sheng整形。因此,CTSD环lu的频率响应自然hui襷hong圃嘉猚aiyang频率整shu倍的输入信hao,chongdang抗混叠滤bo器的作用。

 

 

 

阻xing输入

 

与caiyang保持配置相比,在信hao和基zhun输入中cai用阻xing输入hui更yi于驱动。提供恒定阻xing输入时,不hui产生反冲,可yiwan全移除驱动器。输入不hui产生失真,如图13所shi。而且因为输入阻抗恒定不变,襝an扌枰蛟鲆鎤u差重新调xie系蚦hangⅫ/p>

 

 

 

糲i笰DC提供单极xing电源,mo拟输入也可能是shuang极xing的。因此无需在shuang极前端和ADC之间实施电平转换。ADC的直流xing能可能与输入电阻现在ju有输入共mo相关电流和输入电流时的情况不tong。

 

基zhun负载也ju有阻xing,可yi减少开关反冲,因此无需使用单du的基zhun电压缓冲器。低通滤bo器的电阻可yi在片上,yi便随片上电阻负载一起跟zong(因为它们的材料可能相tong),yi减少增益wu差温度偏移。

 

CTSDjiagoubing非新生事物,但工业和仪器仪表蕏ie〉膁aqu势要qiu在更gao带宽xiaju有直流和交流精度xing能。此外,客户更喜huan适用于da部fen解决方案的单一平tai设计,yibang助他们缩短上市时间。

 

CTSDjiagou相秡a谄渌?嘈虯DCju有多方mian优势,成为gaoxing能yin频和蜂窝shi手机射芼eng岸说戎诙嘤τ玫氖讀uan。这些优势包kuo更容襷hun?珊蚲ong耗更低,但更重要的是,使用CTSD能够解决多个重要的系统问题。由于存在xu多糺i鮭ue陷,CTSD的使用yi前局限于yin频/带宽和较低的动态fanwei。因此,gao精度、gaoxing能/中等带宽应用的主流解决方案一直是gaoxing能nai奎斯te速率转换器,例如逐cibi近型ADC和guocaiyangDTSD转换器。

 

萮uan?珹DI公司最近取de的糺i跬黄颇芸朔??暗膞u多限制。AD7134是首kuan基于CTSD的gao精度直流至400 kHz带宽ADC,可yi实现更gao的xing能gui格,tong时提供直流精度,进而能够解决gaoxing能仪器仪表应用中的多个关键的系统级问题。AD7134也ji成了一个异步caiyang速率转换器(ASRC),能够通guoCTSD的固定caiyang速度,yi不tong的shu据shu率提供shu据。输出shu据速率可yi不受调制器caiyang频率影响,且可yi确保成gong使用CTSD ADC实现不tong粒度的tuntu量。还可yi在粒度级别灵活改变输出shu据速率,从而zhi持用户使用相干caiyang。

 

AD7134的信hao链优势

 

无混叠

 

固有的混叠襷hong葡??硕钥够斓?薭o器的需qiu,由此减少了组件shu量,且使解决方案尺寸更xiao。更重要的是,与抗混叠滤bo器相关的xing能问题du不复存在,例如xia降、失调、增益wu差、相位wu差,yi及系统中的噪sheng等。

 

低延迟信hao链

 

抗混叠滤bo器hui根据襷hong菩鑡iu显著增加信hao链的整体延迟。移除滤bo器可yiwan全消除这zhong延迟,bing在鄕ing拥膕hu控环lu应用中实施精密转换。

 

出se的相位匹配

 

无需在系统级配备抗混叠滤bo器,使多通dao系统的相位匹配xing能de到了da幅提升。非常适簒ian猶iu提供通dao间低失配的应用,例如zhen动监ce、gong聅hi饬俊?hu据caijimokuai和sheng呐等。

 

可kaodi御干扰

 

因为本身ju有滤bogong能,所yiCTSD ADC不受ren何系统级干扰,yi及IC内部干扰影响。秡a贒TSD ADC和SAR ADC,则bi须注意减少ADCcaiyang时的干扰。此外,因为本身ju有滤bogong能,所yi电源xianlu也不hui受干扰。

 

阻xing输入

 

因为ju备恒定的阻xingmo拟输入和基zhun输入,所yiwan全无需再使用专用的驱动器。此外,所有与xing能相关祅ai侍猓??缡У鳌⒃鲆妗⑾辔粀u差和系统噪shengwu差等du不复存在。

 

yi于设计

 

因为设计元件的shu量da幅减少,所yi实现精密xing能的难度也dada降低。从而可缩短设计时间,加快产品上市,jian化BOM管理,bing提gao可kaoxing。

 

尺寸

 

无需使用抗混叠滤bo器、驱动器和基zhun缓冲器,使系统电lu板的尺寸da幅减xiao。可yi使用仪器仪表放da器来直jie驱动ADC。秡a贏D7134,因为它只是一个差fen输入ADC,所yi可yi使用差fen仪表放da器(例如 LTC6373 )作为驱动器。图14中比较了离散时间信hao链和连续时间信hao链。实yan结果显shi,与等效离散时间信hao链相比,连续时间信hao链可yijie省70%的mian积,因而非常适合gao密度多通dao应用。

 

 

总之,AD7134可yi轻松实现设计导入,da幅缩xiao系统尺寸,jian化信hao链设计,提gao系统的可kaoxing,bing缩短整体上市时间,且不hui降低精密仪表应用的xing能canshu要qiu。


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